LABORATORIO 5. MULTIPLEXORES Y DECODIFICADORES

5.1 OBJETIVOS

Desarrollar el uso de multiplexores y decodificadores en el diseño de la lógica combinacional.

5.2 INTRODUCCION

Los problemas presentados a continuación mostrarán la lógica de la circuitería combinacional usada en los los IC comparadores y multiplexores como tales.

5.3 EQUIPOS A EMPLEAR

Tablero de conexiones y la lista de chips a utilizar en su laboratorio.

5.4 PROCEDIMIENTO

1. Un circuito lógico tiene 3 interruptores a su entrada, diseñe el circuito que muestre en un display la cantidad de interruptores que se encuentran cerrados, por ejemplo si el interruptor 1 y 2 están cerrados, el display mostrará el número 2. Implemente el circuito utilizando multiplexores de 8 entradas (74LS151).

2) Una compañía pequeña tiene 10 acciones de capital; en una junta de accionista, cada acción significa un voto de su propietario. Las 10 acciones de capital son propiedad de cuatro personas como se describe a continuación:

Sr. W:1 AcciónSr. X:2 AccionesSr. Y:3 AccionesSr. Z:4 acciones

Cada una de estas personas acciona un interruptor. Cuando da su voto a su favor, cierra el interruptor y cuando vota en contra de alguna medida, abre el interruptor. Es necesario diseñar un circuito que exhiba el número total de acciones que votan a favor de cada medida. Use un display de siete segmentos y un decodificador para mostrar el número requerido. Si todas las acciones votan en contra para una medida, el display deberá quedar en blanco (Se sabe que la entrada binaria de 15 en el circuito decodificador (7447) muestra en blanco todos los siete segmentos). Si 10 acciones votan a favor para alguna medida el display debe mostrar 0, en otra forma mostrará un número decimal igual al número de acciones que dan voto aprobatorio.

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Utilice cuatro multiplexores 74151 para diseñar el circuito que convierta las entradas desde los interruptores de los propietarios del capital en el dígito BCD para el 7447, estas salidas son asertadas en bajo.

5.5 ORIENTACIONES DEL PROFESOR.

Utilice para el diseño con multiplexores la técnica de reducción de variables, guíese por el siguiente esquema general:Donde:

W,X,Y,Z son los interruptores de entrada.A,B,C,D son la salida de cada multiplexor mostrando el número de votos en binario.

+-----------+ +------------+ +-----------+ W -----| DISEÑO +--A----| DECODIFI- | |EXHIBIDOR | X -----| CON +--B----| CADO DE | | DE | Y -----| MUX +--C----| BINARIO A +--7----| SIETE | Z -----| +--D----| B.C.D. |LINEAS |SEGMENTOS | +-----------+ +------------+ | | +-----------+

5.6 TRABAJO PREVIO

Presentar al inicio del laboratorio los circuitos obtenidos.

5.7 OBLIGACIONES DEL ESTUDIANTE.

Entregar un reporte que incluya el resultado obtenido en los laboratorios así como las conclusiones finales.

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